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FUNDAMENTOS DE ELECTRONICA DIGITAL I LÓGICA SECUENCIAL En los circuitos combinacionales las salidas en un instante dependen solamente de las entradas en.

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1 FUNDAMENTOS DE ELECTRONICA DIGITAL I LÓGICA SECUENCIAL En los circuitos combinacionales las salidas en un instante dependen solamente de las entradas en ese mismo instante. Los circuitos SEQUENCIALES tienen elementos de memoria. Las salidas del circuito dependen de una secuencia de entradas. INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

2 FUNDAMENTOS DE ELECTRONICA DIGITAL I Elementos de Memoria Proceso que realiza el circuito Realimentación de Salidas hacia la entrada EntradasSalidas Señal de sincronización (reloj) - Presente -> Cto. Síncrono - No está presente -> Cto. Asíncrono INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

3 FUNDAMENTOS DE ELECTRONICA DIGITAL I CONCEPTO DE ESTADO En sistemas secuenciales la salida Z en un determinado instante de tiempo t i depende no solo del valor de la entrada X en ese instante ti, sino también de todos los valores pasados de X.

4 FUNDAMENTOS DE ELECTRONICA DIGITAL I CONCEPTO DE ESTADO El valor almacenado en los elementos de memoria puede cambiar a lo largo del tiempo. El conjunto de los valores almacenados en un elemento de memoria se denomina estado del sistema. Es frecuente en los sistemas secuenciales tener señales de inicialización reset y de habilitación enable. Los circuitos secuenciales pueden ser asíncronos, es decir, su valor de salida solo depende del valor de sus entradas presentes y pasadas, o síncronos, en donde su salida tambien depende de una entrada de reloj para actualizarse.

5 FUNDAMENTOS DE ELECTRONICA DIGITAL I CONCEPTO DE BIESTABLE (Elemento de Memoria) Un biestable es un circuito capaz de almacenar un bit (1 ó 0). Funcionamiento: Puede almacenar de manera estable un bit hasta que cambien las condiciones de entrada. INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

6 FUNDAMENTOS DE ELECTRONICA DIGITAL I TIPOS DE SISTEMAS SECUENCIALES Asíncronos: La salida puede cambiar en cualquier instante de tiempo en función del estado y de las variables de entrada. Síncronos: Solo pueden cambiar de estado en determinado instante de tiempo, dado por una señal de sincronización (usualmente llamada reloj). Pueden ser: Síncronos por nivel: El sistema solo varía cuando el reloj esta en alto o bajo. Síncronos por flanco: El sistema solo varia en una transición de bajo a alto (flanco de subida) o de alto a bajo (flanco de bajada). INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

7 FUNDAMENTOS DE ELECTRONICA DIGITAL I TIPOS DE SISTEMAS SECUENCIALES Señal de Reloj Circuito Secuencial Asíncrono

8 FUNDAMENTOS DE ELECTRONICA DIGITAL I TIPOS DE SISTEMAS SECUENCIALES Circuito Secuencial Síncrono por Nivel Problema: Mientras la entrada de habilitación se encuentre activa, cualquier cambio en la entrada se propaga a la salida (con el atraso introducido por las compuertas).

9 FUNDAMENTOS DE ELECTRONICA DIGITAL I TIPOS DE SISTEMAS SECUENCIALES Circuito Secuencial Síncrono por Flanco

10 FUNDAMENTOS DE ELECTRONICA DIGITAL I ENTRADAS ASÍNCRONAS Entradas independientes y combinacionales, no dependen del estado o de entradas anteriores. Útiles para reiniciar el sistema. Entradas Asíncronas: *preset: precarga *reset: inicialización INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

11 FUNDAMENTOS DE ELECTRONICA DIGITAL I LATCHES Circuito utilizado para almacenar un bit. Su salida depende tanto de sus entradas como de su salida en un instante de tiempo t. INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

12 FUNDAMENTOS DE ELECTRONICA DIGITAL I LATCH SR (Set - Reset) – Implementación con NOR Diagrama Temporal

13 FUNDAMENTOS DE ELECTRONICA DIGITAL I Diagrama de Estados para un LATCH SR (Set - Reset) – Implementación con NOR Los diagramas de estados son una forma alternativa de representar el comportamiento de los circuitos secuenciales. Los círculos o nodos representan el estado. Arcos representan transiciones entre estados.

14 FUNDAMENTOS DE ELECTRONICA DIGITAL I LATCH SR (Set - Reset) – Implementación con NAND Diagrama Temporal

15 FUNDAMENTOS DE ELECTRONICA DIGITAL I EJEMPLO-> Cuando se usan interruptores mecánicos se produce el fenómeno del “rebote de contacto. Un latch se podría usar como un sistema anti-rebote

16 FUNDAMENTOS DE ELECTRONICA DIGITAL I EJEMPLO-> Dibuje el diagrama de tiempos de salida para la implementación NOR del LATCH SR, cuando se le aplican las señales de entrada mostradas en la figura.

17 FUNDAMENTOS DE ELECTRONICA DIGITAL I LATCH SR con Habilitación (Gated SR LATCH) Precaución: Cuando la señal de habilitación va de alto a bajo, las señales de entrada deben respetar los tiempos de setup y de hold.

18 FUNDAMENTOS DE ELECTRONICA DIGITAL I LATCH D (Data Latch): Se llama seguidor o de Datos y es construido a partir de un Latch SR

19 FUNDAMENTOS DE ELECTRONICA DIGITAL I EJEMPLO-> Diseñe un LATCH D usando solamente compuertas NAND y luego usando solamente compuertas NOR, para comprobar que estén correctos utilice la tabla de verdad vista en la diapositiva anterior.

20 FUNDAMENTOS DE ELECTRONICA DIGITAL I ANOTACIONES ACERCA DE LOS LATCH Para LATCH sin señal de habilitación, cualquier cambio en la entrada se refleja en un cambio en la salida (son transparentes). Cuando tienen habilitación, el LATCH es transparente solo cuando la línea de habilitación está activa. El LATCH se comporta como un elemento de memoria cuando la habilitación se desactiva. INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

21 FUNDAMENTOS DE ELECTRONICA DIGITAL I PROBLEMAS DE LOS LATCH Funcionamiento indeseado al tenerlos habilitados un tiempo largo. Ejemplo: Shift Register de 3-bit Posibles Soluciones: 1.Reducir el Periodo del Reloj 2.Circuitos que solo respondan a el flanco de reloj (Flip-Flops)

22 FUNDAMENTOS DE ELECTRONICA DIGITAL I FLIP-FLOPS Circuitos secuenciales que responden a un cambio de nivel (bajo->alto o alto->bajo) en la entrada de habilitación (no a aun nivel). Se construyen a partir de LATCH. Eliminan el problema de la propagación equivocada. Son de dos tipos: Master-Slave Edge Triggered INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

23 FUNDAMENTOS DE ELECTRONICA DIGITAL I FLIP-FLOP MASTER - SLAVE Son implementados utilizando dos LATCH. Uno de ellos se llama Maestro y el otro se llama esclavo. INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

24 FUNDAMENTOS DE ELECTRONICA DIGITAL I FLIP-FLOP MASTER - SLAVE El Master propaga D cuando el reloj se encuentra en bajo El Slave propaga la salida del Master solo cuando el reloj va de bajo a alto

25 FUNDAMENTOS DE ELECTRONICA DIGITAL I EJEMPLO-> Diseñe un Flip-Flop JK utilizando LATCH SR con habilitación y además compuertas AND, OR y NOT. Utilice la Tabla de verdad mostrada a continuación en la construcción del circuito.

26 SHIFT REGISTER DE 3 bit (FLIP-FLOP MASTER – SLAVE)

27 FUNDAMENTOS DE ELECTRONICA DIGITAL I FLIP-FLOP ACTIVADO POR FLANCO (EDGE TRIGGERED FLIP-FLOP) Es construido con tres LATCH SR Responde a los cambios en el reloj INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

28 FLIP-FLOP ACTIVADO POR FLANCO (EDGE TRIGGERED FLIP-FLOP) Tabla de Verdad de un LATCH SR Cuando el reloj está en 0, las señales S y R están en 1, dejando el latch de salida en el mismo estado. Cuando D cambia en t0: - B va a 0 en t A va a 1 en t Como el reloj todavía está en 0, el LATCH de salida se queda en el mismo estado Cuando clk va a 1 en t1: - S va a 0 en t Q va a 1 en t1+2.8 Cuando clk va a 0 en t2: - S va a 1 en t S y R estan en 1, por lo que el circuito se queda en el estado anterior Cuando D va a 0 en t3: - B va a 1 en t A va a 0 en t Como el reloj está en 0, S y R permanecen en 1 y la salida continua en el estado anterior Cuando clk va a 1 en t4: - R va a 0 en t Q va a 0 en t4+4.2 Cuando D va a 1 en t5: - Como clk=1, B=1 y S=1, R se queda en 0, hasta que clk vuelva a 0. Cuando clk va a 0 en t6: - R va a 1 en t B va a 0 en t A va a 1 en t6+4.2 Cuando clk va a 1 en t7: - S va a 0 en t Q va a 1 en t7+2.8 Un cambio en D en t8 no se propaga a la salida, pero se captura cuando el clk baja en t9 y: - B va a 1 en t A va a 0 en t9+2.8

29 FUNDAMENTOS DE ELECTRONICA DIGITAL I REVISION DEL CONCEPTO DE ESTADO Según lo visto, que es el estado de un Flip-Flop (FF)? Tiene acaso que ver con el reloj? Cuando un FF varía de estado? INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

30 FUNDAMENTOS DE ELECTRONICA DIGITAL I TIPOS DE FLIP-FLOP Se agrupan en dos tipos básicos: JK, SR, T y D. Se describen por su: Símbolo Gráfico: Es la representación gráfica del FF, de sus entradas y salidas. Tabla Característica: para cada entrada y combinación de estados antes de el flanco de subida, determina el estado y las salidas resultantes después del flanco de bajada del reloj. Ecuación característica: Ecuación que representa simbólicamente la tabla característica. Tabla de Excitación: Da el valor que es necesario aplicar a las entradas para llevar el FF del estado presente a un estado deseado.

31 FUNDAMENTOS DE ELECTRONICA DIGITAL I FLIP-FLOP TIPO SR SímboloTabla CaracterísticaEcuación Característica Tabla de Excitación

32 FUNDAMENTOS DE ELECTRONICA DIGITAL I FLIP-FLOP TIPO JK SímboloTabla CaracterísticaEcuación Característica Tabla de Excitación

33 FUNDAMENTOS DE ELECTRONICA DIGITAL I FLIP-FLOP TIPO D SímboloTabla CaracterísticaEcuación Característica Tabla de Excitación

34 FUNDAMENTOS DE ELECTRONICA DIGITAL I FLIP-FLOP TIPO T SímboloTabla CaracterísticaEcuación Característica Tabla de Excitación

35 FUNDAMENTOS DE ELECTRONICA DIGITAL I EJEMPLO-> Utilizando mapas de Karnaugh derive las ecuaciones características para cada uno de los Flip-Flop vistos, tomando en cuenta sus tablas características, mostradas a continuación.

36 FUNDAMENTOS DE ELECTRONICA DIGITAL I EJEMPLOS: Como se hace un FF-D a partir de un FF-JK. Como se realizaria un contador de 0 a 7 a partir de varios FF-D. INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

37 FUNDAMENTOS DE ELECTRONICA DIGITAL I ENTRADAS ASÍNCRONAS (RECORDATORIO) Los FF vistos tienen señales de entrada de control: S, R, J, K y D que modifican el estado. Estas entradas solo son evaluadas con uno de los flancos del reloj. Pueden tener entradas ASINCRONAS que operan de manera independiente a las entradas síncronas y al reloj. Estas predominan sobre las entradas de control síncronas. Entradas Asíncronas: *preset: precarga *reset: inicialización INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

38 FUNDAMENTOS DE ELECTRONICA DIGITAL I ENTRADAS ASÍNCRONAS (EJEMPLO) INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

39 FUNDAMENTOS DE ELECTRONICA DIGITAL I PARÁMETROS TEMPORALES Tiempo de Propagación o Retardo (delay time): Tiempo para que un cambio en la entrada se haga presente en la salida. Tiempo de Establecimiento (setup time): Tiempo mínimo antes del flanco de disparo en que las entradas no pueden variar para producir un resultado correcto. Tiempo de Mantenimiento (hold time): Tiempo mínimo despues del flanco de disparo en que las entradas no pueden variar. Anchura del Reloj (t WH y t WL ): Tiempos de duración mínimos del rejor para producir salidas válidas. Frecuencia Máxima: Máxima frecuencia de variación permitida a la señal de sincronización. Tiempo de preset y clear: Tiempo mínimo que las entradas de preset y clear deben permanecer activas para funcionar correctamente. INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

40 FUNDAMENTOS DE ELECTRONICA DIGITAL I PARÁMETROS TEMPORALES INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

41 FUNDAMENTOS DE ELECTRONICA DIGITAL I VARIACIONES DEL RELOJ (SKEW) Los tres FF están conectados al mismo reloj Los tres caminos que debe seguir el reloj son diferentes El skew en un sistema se refiere a la diferencia entre los tiempos de llegada a los elementos secuenciales (FF) del flanco de subida del reloj. Puede causar que el sistema no funcione debido a la violación de los tiempos de hold y setup, o a que los FF no registran los datos correctamente

42 FUNDAMENTOS DE ELECTRONICA DIGITAL I VARIACIONES DEL RELOJ (SKEW) INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

43 FUNDAMENTOS DE ELECTRONICA DIGITAL I VARIACIONES DEL RELOJ (JITTER) Es la desviación de un reloj de su posición ideal, se da debido a: Ruido Electromagnético Ruido Térmico Variación en las fuentes de alimentación Condiciones de Carga INT. LÓGICA SECUENCIAL ESTADOS BIESTABLES TIPOS DE S. SECUENCIALES E. ASÍNCRONAS LATCHES FLIP-FLOPS Master-Slave Edge Triggered P. TEMPORALES SKEW JITTER

44 FUNDAMENTOS DE ELECTRONICA DIGITAL I VARIACIONES DEL RELOJ (JITTER) Existen varios tipos de JITTER: Period Jitter (Jitter de Periodo): Es la diferencia promedio entre el periodo medido en un sistema y el periodo ideal. Puede causar problemas en el tiempo de setup y hold.

45 FUNDAMENTOS DE ELECTRONICA DIGITAL I VARIACIONES DEL RELOJ (JITTER) Existen varios tipos de JITTER: Cycle to Cycle Jitter (Jitter de ciclo a ciclo): Es la diferencia entre el periodo medido entre dos ciclos de reloj consecutivos.

46 FUNDAMENTOS DE ELECTRONICA DIGITAL I VARIACIONES DEL RELOJ (JITTER) Existen varios tipos de JITTER: Period Jitter (Jitter de periodo): Mide la desviación en el tiempo de transición de un reloj después que han pasado un número grande de ciclos (este número depende de la aplicación).

47 FUNDAMENTOS DE ELECTRONICA DIGITAL I VARIACIONES DEL RELOJ (JITTER) Existen varios tipos de JITTER: Time Interval Error (Error en el Intervalo de Tiempo): Es la desviación de un flanco en el tiempo, cuando es medida a partir de una posición de referencia.


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